포상분야
구 분 | 포상 분야 | 포상 인원 | 포상 내용 |
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강대원상 | 소자/공정 분과 | 1 |
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회로/시스템 분과 | 1 |
* 상기 기재된 포상 내용은 포상 인원 모두에게각각 지급됨
후보자격
- 국내 대학교, 공공연구기관, 산업계 등 실제 반도체분야 연구개발 업무에 종사하며, 반도체 산업에 기여한 업적이 큰 자
추진일정
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2022.10.4(화) ~ 2022.11.30(수)
후보 추천 접수
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2022.12월
심사 및 수상자 선정
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2023.2.13(월) ~ 2023.2.15(수)
학술대회 기간 中 강대원상 시상
접수방법
- 접수 기간: 2022.10.4.(화) ~ 2021.11.30.(수) 18:00까지 도착분
- 제출 서류: 포상추천서 2부(한글파일 1부, 스캔본 1부), 개인정보활용동의서 1부
제 출 서 류 | 유 의 사 항 |
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포상추천서 (별첨1) |
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개인정보활용동의서 (별첨2) |
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- 접수방법: 포상추천서 및 제출서류 첨부하여 이메일(smhong@ksia.or.kr) 제출
- 제출/문의: 한국반도체연구조합 홍선미PM (E-Mail : smhong@ksia.or.kr / Tel : 02-570-5263)
- 제 1회 강대원상 수상자(KCS 2017)
- 제 2회 강대원상 수상자(KCS 2018)
- 제 3회 강대원상 수상자(KCS 2019)
- 제 4회 강대원상 수상자(KCS 2020)
- 제 5회 강대원상 수상자(KCS 2022)
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소자·공정 분야
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수상자 故 박병국 교수 (서울대학교)논문 Three-Dimensional Stacked Array NAND Flash Memory (2009년) 외 다수
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회로·시스템 분야
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수상논문 A 1.5-V 493-㎼ Delta-Sigma Modulator with 87-dB Dynamic Range (2007년)저자 Hyungdong Roh, Youngkil Choi, Sanho Byun, Hyuntae Lee, Kyoungsik Kang, and Jeongjin Roh논문 발표 당시 소속 Hanyang University수상자(2019년 2월 기준 현 소속) 제 1저자 - 노형동 책임 (삼성전자)
노정진 교수 (한양대학교)
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소자·공정 분야
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수상자 황철성 교수 (서울대학교)논문 Atomic Structure of Conducting Nanofilaments in TiO2 Resistive Switching Memory (2010) 外 다수
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회로·시스템 분야
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수상논문 Loosely Coupled Memory-Based Decoding Architecture for Low Density Parity Check Codes (2006년)저자 Se-Hyeon Kang and In-Cheol Park논문 발표 당시 소속 KAIST수상자(2019년 2월 기준 현 소속) 강세현 박사(삼성전자), 박인철 교수(KAIST)
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소자·공정 분야
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수상자 황현상 교수 (포항공과대학교)논문 Demonstration of Bi-Directional Selector in 8 inch Wafer Process with Fully CMOS Compatibility for ReRAM Cross-Point Array 外 다수
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회로·시스템 분야
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수상논문 A down-conversion mixer for direct conversion receiver using vertical bipolar transistor in deep n-well CMOS technology저자 남일구, 이귀로논문 발표 당시 소속 KAIST수상자(2019년 2월 기준 현 소속) 이귀로 교수 (KAIST), 남일구 교수 (부산대학교)
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소자·공정 분야
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수상자 손현철 교수 (연세대학교)논문 Ovonic Threshold Switching Phenomenon in Polycrystalline Zinc Telluride Thin Films Deposited by RF Sputtering System 外 다수
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회로·시스템 분야
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수상자 유현규 연구위원 (ETRI)논문 RF CMOS Technology for the RF System on a Chip
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소자·공정 분야
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수상자 최양규 교수 (KAIST)논문 Nanoscale CMOS spacer FinFET for the terabit era
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회로·시스템 분야
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수상자 이승훈 교수 (서강대학교)논문 A 2.2mW 12-bit 200MS/s 28nm CMOS Pipelined SAR ADC with Dynamic Register-Based High-Speed SAR Logic
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